Voir la source de Mémoire vive dynamique

{{Voir homonymes|Dram|Dynamic}}
La '''mémoire vive dynamique''' (en anglais '''''DRAM''''' pour '''''{{lang|en|Dynamic Random Access Memory}}''''') est un type de [[mémoire vive]] compacte et peu dispendieuse.

[[Fichier:DRAM Cell Structure (Model of Single Circuit Cell).PNG|thumb|cellule DRAM (1 transistor et un [[condensateur]]).]]
La simplicité structurelle de la DRAM — un [[wikt:pico|pico]]-[[condensateur]] et un transistor pour un bit — permet d'obtenir une densité élevée. Son inconvénient réside dans les [[Courant de fuite|courants de fuite]] des pico-condensateurs : l'information disparaît à moins que la charge des condensateurs ne soit [[rafraîchissement de la mémoire|rafraîchie]] avec une période de quelques [[Seconde (temps)|milliseconde]]s. D'où le terme de ''dynamique''. ''{{lang|la|A contrario}}'', les [[Mémoire vive statique|mémoires vives statiques]] (SRAM) n'ont pas besoin de rafraîchissement mais utilisent plus d'espace.

Sans alimentation, la DRAM perd ses données, ce qui la range dans la famille des [[mémoire volatile|mémoires volatiles]].

La mémoire DRAM utilise la [[capacité parasite]] drain/substrat d'un [[transistor à effet de champ]].

Les puces mémoires sont regroupées sur des supports ''[[Single Inline Memory Module|SIMM]]'' (contacts électriques identiques sur les {{nobr|2 faces}} du connecteur de la carte de barrette) ou ''[[Dual Inline Memory Module|DIMM]]'' (contacts électriques séparés sur les {{nobr|2 faces}} du connecteur).

[[Fichier:DRAM DDR2 512.jpg|thumb|Une barrette DRAM DDR2.]]
[[Fichier:SDRAM 128MB 133MHz.jpg|thumb|[[SDRAM]].]]
[[Fichier:RAMBUS-Memory.jpg|thumb|[[RDRAM]].]]
[[Fichier:KVR400X64C3AK2 - 2G.jpg|thumb|[[DDR SDRAM]].]]
[[Fichier:RAM 1GB with cooler.jpg|thumb|[[DDR2 SDRAM]].]]
[[Fichier:2011 elixir M2F4G64CB8HB5N-CG.jpg|thumb|[[DDR3 SDRAM]].]]
[[Fichier:XDRAM.jpg|thumb|[[XDR DRAM]].]]

== Types de mémoire vive dynamique ==
Les mémoires vives dynamiques ont connu différentes versions :
* [[EDO]] : (de l'anglais ''{{langue|en|Extended Data Out}}''). Mémoire vive utilisée dans les ordinateurs au début des {{nobr|années 1990}} avec la génération des [[Intel Pentium|Pentium]] première génération<ref>{{en}} [http://www.dictionary.com/browse/extended-data-out-dynamic-random-access-memory ''{{lang|en|extended data out dynamic random access memory}}''], sur le site dictionary.com, consulté le 6 juin 2016.</ref>. Elle est devenue obsolète dès 1997.
* [[SDRAM]] : de l'anglais ''{{lang|en|Synchronous Dynamic RAM}}''. Elle est utilisée comme mémoire principale et vidéo. La transition s'est faite lors du passage du [[Pentium II|{{nobr|Pentium {{II}}}}]] au [[Pentium III|{{nobr|Pentium {{III}}}}]]. Les différents types de SDRAM se distinguent par leur fréquence de fonctionnement, typiquement {{unité|66, 100 et 133 MHz}}. Les barrettes comportent {{nobr|168 broches}}. Elle est obsolète aujourd'hui.
* [[Mémoire vidéo|VRAM]] : de l'anglais ''{{lang|en|Video RAM}}''. Présente dans les [[Carte graphique|cartes graphiques]]. Elle sert à construire l'image vidéo qui sera envoyée à l'écran d'ordinateur via le convertisseur [[RAMDAC]].
* [[RDRAM]] : de l'anglais ''{{lang|en|Rambus Dynamic RAM}}''. Développée par la société [[Rambus]], elle souffre notamment d'un prix beaucoup plus élevé que les autres types de mémoires et de brevets trop restrictifs de la part de la société créatrice. Elle est utilisée pour les machines de génération [[Pentium III|{{nobr|Pentium {{III}}}}]] et {{nobr|[[Pentium 4]]}}.
* [[DDR SDRAM]] : de l'anglais ''{{lang|en|Double Data Rate Synchronous Dynamic RAM}}''. Utilisée comme mémoire principale et comme mémoire vidéo, elle est synchrone avec l'horloge système mais elle double également la largeur de [[bande passante]] en transférant des données deux fois par cycle d'horloge au lieu d'une seule pour la SDRAM. On distingue les DDR PC1600, PC2100, PC2700, PC3200{{etc.}} Le nombre représente la quantité théorique maximale de transfert d'information en {{unité|[[Octet|Mégaoctets par seconde]]}}. Elle s'est généralisée dans les ordinateurs grand public avec les générations [[Pentium III|{{nobr|Pentium {{III}}}}]] et {{nobr|[[Pentium 4]]}}. Elle comporte {{nobr|184 broches}}. {{refnec|Cette mémoire est en voie de disparition avec le {{lesquels|retrait des ordinateurs}} du début des {{nobr|années 2000}}}}.
* [[DDR2 SDRAM]] : de l'anglais ''{{lang|en|Double Data Rate two [[SDRAM]]}}''. Il s'agit de la {{2e|génération}} de la technologie [[DDR SDRAM|DDR]]. Selon la fréquence d'utilisation recommandée on distingue les DDR2-400, 533, 667, 800 et 1066. Le nombre (400, 533{{etc.}}) étant la fréquence de fonctionnement. Certains constructeurs privilégient la technique d'appellation basée sur la quantité de données théoriquement transportables (PC2-4200, PC2-5300{{etc.}}), mais certains semblent retourner à la vitesse réelle de fonctionnement afin de distinguer plus clairement la DDR2 de la génération précédente. Elle comporte normalement {{nobr|240 broches}}.
* [[DDR3 SDRAM]] : de l'anglais ''{{lang|en|Double Data Rate three [[SDRAM]]}}''. Il s'agit de la {{3e|génération}} de la technologie [[DDR SDRAM|DDR]]. Les spécifications de cette nouvelle version sont réalisées par [[Joint Electron Device Engineering Council|JEDEC]]. Les premiers [[Ordinateur personnel|micro-ordinateur]]s pouvant utiliser la DDR3 sont arrivés sur le marché pour la fin de 2007. La DDR3 fournit un débit deux fois plus important que la DDR2. Début 2014 c'est la technologie la plus communément utilisée dans les ordinateurs grand public pour la mémoire principale.
* [[DDR4 SDRAM]] : de l'anglais ''{{lang|en|Double Data Rate fourth [[SDRAM]]}}. ''Il s'agit de la {{4e|génération}} de la technologie [[DDR SDRAM|DDR]]. Les spécifications de cette nouvelle version sont réalisées par JEDEC. Les premiers [[Ordinateur personnel|micro-ordinateur]]s pouvant utiliser la DDR4 sont arrivés sur le marché pour la fin de 2014. La DDR4 fournit un débit deux fois plus important que la DDR3.
* [[DDR5 SDRAM]] : c'est la cinquième génération.
* [[XDR DRAM]] : de l'anglais ''{{lang|en|XDimm Rambus RAM}}''. Technologie basée sur la technologie Flexio développée par [[Rambus]]. Elle permet d'envisager des débits théoriques de {{unité|6.4 à 12.8 Gio/s}} en rafale.

== Principes de fonctionnement ==
[[Image:square array of mosfet cells read.png|thumb|250px|Principes de fonctionnement pour la lecture d'une matrice DRAM simple 4 <math>\times</math>4.]]
[[Image:DRAM_cell_field_(details).png|thumb|250px|Structure de base d’une matrice de cellules DRAM.]]

La DRAM est généralement disposée selon un réseau rectangulaire (matrice) de cellules de stockage de charge composé d’un condensateur et d’un transistor par bit de données. La figure de droite montre un exemple simple avec une matrice de cellules quatre par quatre. Certaines matrices DRAM comptent plusieurs milliers de cellules en hauteur et en largeur<ref>{{Lien web
 |url         = http://www.eng.utah.edu/~cs7810/pres/11-7810-12.pdf
 |titre       = Lecture 12: DRAM Basics
 |date        = 2011-02-17
 |consulté le  = 2015-03-10
 |langue   = en-us
 |site     = utah.edu
}}</ref>{{,}}<ref>{{Lien web|langue=en-us|format=pdf
 |titre       = Lecture 20: Memory Technology - Archivé depuis l'original
 |date        = 2004-11-23
 |consulté le  = 2015-03-10
 |auteur     = David August
 |site     = cs.princeton.edu
 |pages       = 3–5
 |url  = https://web.archive.org/web/20050519185856/http://www.cs.princeton.edu/courses/archive/fall04/cos471/lectures/20-Memory.pdf
}}</ref>.

Les longues lignes horizontales reliant chaque rangée sont appelées ''lignes de mots''. Chaque colonne de cellules est composée de deux ''lignes de bits'', chacune connectée à toutes les autres cellules de stockage de la colonne (l’illustration de droite n’inclut pas ce détail important). Elles sont généralement appelées lignes de bits « + » et « - ».

Un [[amplificateur de détection]] est essentiellement une paire d’[[Inverseur (porte logique)|inverseurs]] croisés entre les lignes de bits. L'entrée du premier inverseur est connectée à la ligne de bits + et sa sortie à la ligne de bits −. L’entrée du deuxième inverseur est connectée à la ligne de bits et sa sortie à la ligne de bits +. Il en résulte une rétroaction positive qui se stabilise une fois qu’une ligne de bits est à la tension la plus élevée possible et que l’autre ligne de bits est à la tension la plus basse possible.

=== Lecture d’un bit de données à partir d’une cellule de stockage ===
# Les amplificateurs de détection sont déconnectés<ref name="Kenner:24,30">{{harvnb|Keeth|Baker|Johnson|Lin|2007|pp=24–30}}</ref>. 
# Les lignes de bits sont préchargées à des tensions exactement égales qui se situent entre les niveaux logiques haut et bas (par exemple, 0,5 V si les deux niveaux sont 0 et 1 V). Les lignes de bits sont physiquement symétriques pour maintenir la capacité égale, et donc à ce moment-là, leurs tensions sont égales<ref name="Kenner:24,30"/>.
# Le circuit de précharge est désactivé. Parce que les lignes de bits sont relativement longues, elles ont une [[Capacité électrique|capacité]] suffisante pour maintenir la tension préchargée pendant une courte période. Il s’agit d’un exemple de logique dynamique<ref name="Kenner:24,30"/>.
# La ligne de mots de la rangée souhaitée est ensuite pilotée vers le haut pour connecter le condensateur de stockage d’une cellule à sa ligne de bits. Cela provoque la conduction du transistor, transférant la charge de la cellule de stockage à la ligne de bits connectée (si la valeur stockée est de 1) ou de la ligne de bits connectée à la cellule de stockage (si la valeur stockée est de 0). Étant donné que la capacité de la ligne de bits est généralement beaucoup plus élevée que la capacité de la cellule de stockage, la tension sur la ligne de bits augmente très légèrement si le condensateur de la cellule de stockage est déchargé et diminue très légèrement s'il est chargé (par exemple, 0,54 et 0,45 V dans les deux cas). Comme l’autre ligne de bits reste à 0,50 V, il y a une petite différence de tension entre les deux lignes de bits torsadées<ref name="Kenner:24,30"/>.
# Les amplificateurs de détection sont maintenant connectés aux paires de lignes de bits. Une rétroaction positive se produit alors à partir des inverseurs croisés, amplifiant ainsi la petite différence de tension entre les lignes de bits paires et impaires d’une colonne particulière jusqu’à ce qu’une ligne de bits soit complètement à la tension la plus basse et l’autre à la tension la plus haute. Une fois que cela s’est produit, la rangée est « ouverte » (les données de cellule souhaitées sont disponibles)<ref name="Kenner:24,30"/>.
# Toutes les cellules de stockage de la rangée ouverte sont détectées simultanément et les sorties de l’amplificateur de détection sont verrouillées. Une adresse de colonne sélectionne ensuite le bit verrouillé à connecter au bus de données externe. Les lectures de différentes colonnes dans la même rangée peuvent être effectuées sans délai d’ouverture de rangée car, pour la rangée ouverte, toutes les données ont déjà été détectées et verrouillées<ref name="Kenner:24,30"/>.
# Pendant que la lecture des colonnes d'une rangée ouverte se produit, le courant remonte les lignes de bits à partir de la sortie des amplificateurs de détection et recharge les cellules de stockage. Cela renforce (c’est-à-dire « rafraîchit ») la charge dans la cellule de stockage en augmentant la tension dans le condensateur de stockage s’il était chargé au départ, ou en le maintenant déchargé s’il était vide. En raison de la longueur des lignes de bits, il y a un délai de propagation assez long pour que la charge soit retransférée au condensateur de la cellule. Cela prend beaucoup de temps après la fin de l’amplification de détection et se chevauche donc avec une ou plusieurs lectures de colonne<ref name="Kenner:24,30"/>.
# Une fois la lecture de toutes les colonnes de la rangée ouverte en cours effectuée, la ligne de mot est désactivée pour déconnecter les condensateurs de la cellule de stockage des lignes de bits (la rangée est « fermée »). L’amplificateur de détection est désactivé et les lignes de bits sont à nouveau préchargées<ref name="Kenner:24,30"/>.

=== Écriture dans une cellule de stockage ===
[[Fichier:Square array of mosfet cells write.png|thumb|250px|right|Ecriture dans une cellule de stockage.]]

Pour stocker des données, une rangée est ouverte et l’amplificateur de détection d’une colonne donnée est temporairement forcé à l’état haute ou basse tension souhaité, provoquant ainsi la charge ou la décharge du condensateur de la cellule de stockage par la ligne de bits à la valeur souhaitée. En raison de la configuration à rétroaction positive de l’amplificateur de détection, il maintiendra une ligne de bits à une tension stable même après la suppression de la tension de forçage. Lors d’une écriture dans une cellule particulière, toutes les colonnes d’une rangée sont détectées simultanément, tout comme lors de la lecture, de sorte que bien que la charge du condensateur de la cellule de stockage d’une seule colonne soit modifiée, la rangée entière est rafraîchie (réécrite), comme illustré dans la figure de droite<ref name="Kenner:24,30"/>.

== Sécurité ==
=== Attaque par démarrage à froid ===
{{Article détaillé|Attaque par démarrage à froid}}
Bien que les spécifications de la mémoire dynamique indiquent que la conservation des données de la mémoire n'est garantie que si la mémoire est rafraîchie régulièrement (typiquement toutes les {{unité|64 ms}}), les condensateurs de cellules de mémoire conservent souvent leurs charges durant des périodes significativement plus longues, en particulier à basses températures<ref name="citp" />. Sous certaines conditions, la plupart des données de la mémoire DRAM peuvent être récupérées même si la mémoire n'a pas été rafraîchie depuis plusieurs minutes<ref name="Scheick1">{{article|langue=en |nom1=Scheick |prénom1=Leif Z. | nom2=Guertin |prénom2=Steven M. |nom3=Swift |prénom3=Gary M. |titre=Analysis of radiation effects on individual DRAM cells |journal={{lang|en|IEEE Trans. on Nuclear Science}} |volume=47 |numéro=6 |pages=2534–2538 |date =décembre 2000 |url=http://ieeexplore.ieee.org/xpl/articleDetails.jsp?arnumber=903804 |issn= 0018-9499 |doi=10.1109/23.903804 |consulté le=8 aout 2013}}.</ref>.

Cette propriété peut être utilisée pour contourner certaines mesures de sécurité et récupérer des données stockées dans la mémoire et supposées avoir été détruites à la mise hors tension de l'ordinateur. {{refnec|Pour ce faire, il suffit de redémarrer l'ordinateur rapidement et copier le contenu de la mémoire vive}}. {{refnec|Alternativement, on peut refroidir les puces de mémoire et les transférer sur un autre ordinateur}}. Une telle attaque a réussi à contourner des systèmes populaires de [[Chiffrement de disque dur|chiffrement de disque]], tels que {{lang|en|[[TrueCrypt]]}}, {{lang|en|[[BitLocker Drive Encryption]]}} de [[Microsoft]], et {{lang|en|[[FileVault]]}} d'[[Apple]]<ref name="citp">{{Lien archive|langue=en |titre={{lang|en|Center for Information Technology Policy Lest We Remember: Cold Boot Attacks on Encryption Keys}} |horodatage archive=20110722182409 |url=http://citp.princeton.edu/memory/}} 080222 citp.princeton.edu.</ref>. Ce type d'attaque contre un ordinateur est appelé une [[attaque par démarrage à froid]].

=== Attaque par martèlement de mémoire ===
{{Article détaillé|Martèlement de mémoire}}
Le [[martèlement de mémoire]] est un effet secondaire imprévu dans les mémoires dynamiques à accès directe (DRAM) qui provoque une fuite de charge électrique dans des cellules de mémoire, et en conséquence provoque une interaction électrique entre ces cellules et d'autres cellules voisines.

== Notes et références ==
{{Références}}
{{Traduction/Référence|en|Dynamic random-access memory|587710984}}

== Annexes ==
=== Lien externe ===
* [http://linuxfr.org/2009/10/09/25997.html Article sur la fiabilité de la mémoire vive DRAM]

{{Palette|Types de mémoires selon la volatilité|Types de mémoires vives|Société DRAM}}
{{Portail|électricité et électronique|informatique}}

[[Catégorie:Mémoire informatique]]